PCIe® 8.0 至 2028 年：迎接 256 GT/s 與高頻寬運算

2025年8月5日，PCI-SIG 正式發表 PCI Express®（PCIe®）8.0規範¹－這個里程碑延續了 PCIe®每三年頻寬翻倍的悠久傳統。憑藉256.0 GT/s的原始位元速率，以及在x16配置下高達1 TB/s的雙向總吞吐量，PCI-SIG 正為運算密集型環境中的高速資料互連新時代奠定基礎。

基於 PCIe 7.0滿足未來頻寬需求

該公告發佈於 PCIe 7.0 推出僅數月之後，進一步彰顯了 PCI-SIG 致力於在性能提升上與市場需求保持同步，以滿足人工智慧、機器學習、高速網路及先進計算工作負載的承諾。

面對 I/O 互連技術在速度與效率方面日益增長的壓力，PCIe 8.0 致力於在提升原始效能的同時，透過實現以下目標來兼顧延遲與系統可擴展性：

將每頻道吞吐量提升至256 GT/s，較 PCIe 7.0翻倍
驗證延遲與FEC效能目標達成情況
透過協定優化提升頻寬利用率
保持與早期PCIe版本的向後相容性
提升功耗效率－此指標已成為關鍵設計約束
評估新型連接器技術以保障訊號完整性與可擴展性

突破 PCIe 8.0物理層限制

不過，要達到 256.0 GT/s 的速率，以及在 x16 配置下達到 1 TB/s 的雙向傳輸，還需克服重大的訊號完整性挑戰。 PCIe 8.0 預計將延續 PCIe 6.0 與 7.0 引入的 PAM4 調變、Flit Mode 編碼和前向糾錯（FEC）技術。但在主機板上跨越數十公分銅走線時，要維持如此高速傳輸已逼近現有技術極限。 PCI-SIG 正在探索新的互連方案，以兼顧效能、訊號雜訊比、插入損耗和能源效率。

AI/ML、HPC 和邊緣運算的持續產業需求

PCIe® 路線圖始終緊跟著產業發展趨勢。資料中心網路正積極採用 PCIe 6.0，並已對 PCIe 7.0 表現出濃厚興趣。 PCIe 8.0 預計還將涵蓋更多應用場景，包括：

人工智慧/機器學習（AI/ML）
邊緣運算
量子計算
高效能運算（HPC）
超大規模資料中心
汽車與航空航天系統

同時，全球PCIe®重定時器市場已蓄勢待發，預計將實現10.7%的複合年增長率，市場總估值將從2024年的6,136萬美元躍升至2029年的逾10億美元²。

為 PCIe 7.0、8.0及更高版本奠定基礎

新一代平台的開發者可透過符合 PCIe 6.0 標準來確保產品符合當下規範，並為未來過渡做好準備。

Granite River Labs（GRL）是第一個獲授權開展 PCIe® 5.0 和 4.0 官方合規性測試的實驗室，在支持 PCI-SIG 委員會、研討會及生態系統夥伴方面擁有深厚積累。

GRL PCIe測試服務

PCIe 4.0和5.0（至16GT/s）官方合規性測試及整合商清單認證，適用於附加卡（設備）和系統（主機）。
PCIe 6.0、5.0、4.0及更早版本基礎規格（ASIC）與CEM（系統）規格預合規性與特性測試，涵蓋積體電路、終端設備（設備）、根複合體（主機/系統）、背板及連接器。

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GRL PCIe 解決方案

為助力 PCIe 技術持續演進，GRL 推出了業界領先的 PCIe® 6.0 基準與 CEM 接收器測試自動化解決方案（GRL-PXE6-RXA）。此方案支援安立 MP1900A BERT，並在 PCI-SIG® 2024 開發者大會首次亮相。憑藉經矽驗證的 Synopsys PCIe 6.x IP，GRL-PXE6-RXA 大幅簡化了 PCIe 6.0 規範合規性測試。

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